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SAK-TC277TP-64F200N CC

SAK-TC277TP-64F200N DC appartiene alla famiglia TC27xT . La sua innovativa architettura multicore, basata su un massimo di tre 32-CPU TriCore bit indipendenti, è stata progettata per soddisfare i più elevati standard di sicurezza, aumentando contemporaneamente significativamente le prestazioni. Dotata di un triplo TriCore con 200 MHz, 4 MB di memoria Flash e un potente modulo timer generico (GTM), la serie TC27xT mira a una complessità ridotta, un consumo energetico ai vertici della categoria e un notevole risparmio sui costi.

Descrizione

Caratteristiche

• Microcontrollore ad alte prestazioni con tre core CPU

• Due CPU TriCore superscalari 32-bit (TC1.6P), ciascuna con le seguenti caratteristiche:

– Prestazioni in tempo reale superiori

– Forte gestione dei bit

– Funzionalità DSP completamente integrate

– Unità ad accumulazione multipla in grado di sostenere 2 operazioni MAC per ciclo

– Unità in virgola mobile (FPU) completamente pipelined

– funzionamento fino a 200 MHz a pieno range di temperatura

– fino a 120 Kbyte di RAM per Scratch-Pad di dati (DSPR)

– fino a 32 Kbyte di RAM per Scratch-Pad di istruzioni (PSPR)

– 16 Kbyte di cache di istruzioni (ICACHE)

– 8 Kbyte di cache dati (DCACHE)

• CPU TriCore scalare ad alta efficienza energetica (TC1.6E), con le seguenti caratteristiche:

– Compatibilità codice binario con TC1.6P

– funzionamento fino a 200 MHz a pieno range di temperatura

– fino a 112 Kbyte di RAM per Scratch-Pad di dati (DSPR)

– fino a 24 Kbyte di RAM per Scratch-Pad di istruzioni (PSPR)

– Cache istruzioni da 8 Kbyte (ICACHE)

– 0 Buffer di lettura dati (DRB) da .125 Kbyte

• Shadow core bloccati per un TC1.6P e per TC1.6E

• Molteplici memorie su chip

– Tutte le NVM e le SRAM integrate sono protette da ECC

– fino a 4 Mbyte di memoria flash di programma (PFLASH)

– Memoria Flash Dati fino a 384 Kbyte (DFLASH) utilizzabile per emulazione EEPROM

– 32 Kbyte di memoria (LMU)

– BootROM (BROM)

• 64-Channel DMA Controller con trasferimento dati sicuro

• Sofisticato sistema di interrupt (protetto da ECC)

• Struttura bus on-chip ad alte prestazioni

– 64-Bit Cross Bar Interconnect (SRI) che offre un rapido accesso parallelo tra bus master, CPU e memorie

– 32-bit System Peripheral Bus (SPB) per unità periferiche e funzionali su chip

– Un ponte di autobus (ponte SFI)

• Modulo di sicurezza hardware (HSM) opzionale su alcune varianti

• Unità di gestione della sicurezza (SMU) che gestisce gli allarmi dei monitor di sicurezza

• Memory Test Unit con funzioni ECC, Inizializzazione memoria e MBIST (MTU)

• Hardware I/O Monitor (IOM) per il controllo degli I/O digitali

• Versatili unità periferiche su chip

– Quattro canali seriali asincroni/sincroni (ASCLIN) con supporto hardware LIN (V1.3, V2.0, V2.1 e J2602) fino a 50 MBaud


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